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BSVによるUARTの設計 (3) |
トップモジュール
例によって、テストベンチにクロックとリセットを供給する最上位を設計します。
top.v
`timescale 1ns/1ns
module top();
/*AUTOREGINPUT*/
/*AUTOWIRE*/
mkTb mkTb_inst(/*AUTOINST*/);
initial begin
RST_N = 1'b0;
#10;
RST_N = 1'b1;
end
initial begin
CLK = 1'b0;
forever begin
#5 CLK = ~CLK;
end
end
initial begin
$dumpfile("mkTb.vcd");
$dumpvars;
end
endmodule
追記:本モジュールは不要ということが判明しました。
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